ARM多核和MIPS多执行绪嵌入式处理器技术剖析

来源：互联网　作者：佚名　责任编辑：admin　发表时间:2018-11-05 11:45　

核心提示：在嵌入式装置中建置多核心（包含同质或异质）以及多执行绪技术，的确能带来诸多效益，尤其是改进系统效能方面最为明显。尽管RISC嵌入式技术所面临的挑战越来越多，但是在维持以往嵌入式软件资源兼容性的前提之下，能够改善其未来适用性，并且有效提升新系统

在嵌入式装置中建置多核心（包含同质或异质）以及多执行绪技术，的确能带来诸多效益，尤其是改进系统效能方面最为明显。

尽管RISC嵌入式技术所面临的挑战越来越多，但是在维持以往嵌入式软件资源兼容性的前提之下，能够改善其未来适用性，并且有效提升新系统的效能表现，使其不失为良好的解决方案。

应用决定多核或多绪

多核心与多执行绪在效能表现上有其帮助，但是效能与这些技术的内建其实并没有绝对关系，会造成这样的原因主要是应用环境的需求。以手机为例，整合于手机内的SoC芯片虽然是属于多核心架构的一环，但是手机采用的SoC芯片多为应用处理器，其整合的核心并非完全属于同性质架构，同质多核心在嵌入式系统实际应用上的案例其实非常少。

而多执行绪处理器在汽车电子或者是嵌入式网络环境中扮演着重要的角色，但是也有厂商利用数颗多执行绪芯片组成多核心与多执行绪兼备的运算架构，换句话说，两者并不是单纯选边站而已，根据实际应用的需求，自行搭配或开发最终解决方案也成了许多厂商面对问题时的态度。这也代表着，在选择嵌入式系统的基础架构时，处理器本身只是应用的1个环节，如何能够针对应用将所需的效能最大化，必须依照产品的不同而有各种考虑。

不只是意气的技术之争

真正的同质多核心架构－ARM11 MPCore

在嵌入式多核心应用处理器这方面的领域，目前以ARM为技术领导者，虽然该公司本身并无晶圆厂，而纯粹以IP的形式出售处理器架构，由于定位正确，在短短的数年间取得了极大的市场地位，全世界绝大多数的手持式装置都嵌入了ARM的处理器技术。

以其技术的发展历程来看，早期的ARM7架构本身能够满足一些音效编译码应用。而在增加16位饱和运算指令和提高ARM9核心速度后，不仅能完成音效编译码工作，以及以大约80 MHz、15 画格/秒速度下的MPEG-4 QCIF（4分之1 CIF分辨率）编码。在ARM11 V6指令集架构上增加速度和SIMD指令后，就可以实现VGA分辨率的 H.264 编码。再进一步到最新的Cortex A8与其基于64位SIMD架构的Neon加速器搭配工作之下，就可以完成 30 画格/秒的 MPEG-4 VGA 编码，所花周期只有 ARM11 的一半。在实际情况下，该工作需要大约 300 MHz。为了使这些选项对使用者更加可行，ARM 正在开发一个并行编译器原型，它可以提取资料并行机制，并用 SIMD 硬件来使用它。

ARM11 MPCore乃是在ARM11核心的基础组成，架构上属于V6指令体系。根据不同应用的需要，MPCore可以被配置为1∼4个处理器的组合方式，根据官方表示，其最高性能约可达到2600 Dhrystone MIPS的程度。MPCore是标准的同质多核心处理器，，组成MPCore的是4个基于ARM11架构的处理器核心，由于多核心设计的优点是在频率不变的情况下让处理器的性能获得明显提升，因此可望在多任务应用中拥有良好的表现，这一点很适合未来家庭消费电子的需要。例如，机上盒在录制多个频道电视节目的同时，还可通过因特网收看数字视讯点播节目、车内导航系统在提供导航功能的同时，仍然有余力可以向后座乘客播放各类视讯娱乐串流等。

在这类应用环境下，多核心结构的嵌入式处理器能够表现出极强的性能优势。根据原厂数据，MPCore多处理器可支持高达4路共享快取结构的对称多处理器（four-way cache coherent symmetric multiprocessing，SMP）、或者是4路不对称多处理器（four-way asymmetric multiprocessing，AMP）以及4路兼有对称/不对称的混合式多处理器系统。其设计的高灵活设计在理论上可以满足各种跨领域应用对运算性能的弹性需求，确保系统可获得一流的响应能力或数据吞吐量。(责任编辑：admin)

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