PCI9054芯片接口设计中若干问题的深入研究

随着ISA总线逐步被淘汰，基于PCI总线的扩展板越来越被广泛地应用于各种高速、大数据量的处理系统中。尽管有许多供就商提供了各种通用的PCI总线扩展板，但在较多应用场合，用户还必须自行设计满足自己特殊需求的PCI扩展板，这就不可避免地会遇到PCI总线接口问题。对于绝大多数用户而言，选择专用PCI接口芯片进行PCI接口设计是必然的选择。

PIC9054是PLX公司推出的一种32位33MHz的PCI总线主控I/O加速器。它采用多种先进技术，使复杂的PCI接口应用设计变得相对简单。该芯片是目前主流的PCI接口芯片之一，其功能和性能如下：

·符合PCI V2.2规范，包含PCI电源管理特性；

·支持PCI双地址周期，地址空间高达4GB；

·提供两个独立的可编程DMA控制器，每个通道均支持块和分散/集中的DMA方式；

·PCI与Local Bus之间数据传输速率高达132MB/s；

·支持复用或非复用的32位局部总线操作，本地总线支持8位、16位和32位外围设备和存储设备，本地总线有三种工作模式：M模式、C模式和J模式，可通过模式选择引脚加以选择；

·PCI9054内部有可编程的FIFO，可以实现零等待突发传输及本地总线与PCI总线之间的异步操作，本地总线速率高达50MHz。

·支持可编程突发管理、可编程预取数技术和可编程中断产生；

·3.3V/5V兼容。

1 PCI9054的工作模式

PCI9054有M、C、J三种工作模式，可通过模式选择控制引脚MODE[1:0]进行控制。当MODE[1:0]=“11”时，PCI9054工作在M模式；当MODE[1:0]="00"时,PCI9054工作在C模式;当MODE[1:0]=“01”时，PCI9054工作在J模式；当MODE[1:0]="10"时，娄保留工作状态。

M模式可与Motorola MPC850或MPC860系列高性能微处理器进行无缝连接；C模式可与Intel i960系列高性能微处理器进行无缝连接；J模式地址和数据线复用，应用很复杂，不过在一些特殊的应用场合，利用J模式和TI公司6000系列DSP的HPI口进行接口，其控制逻辑将比其它模式简单得多。

事实上，C模式能够满足绝大多数的应用需求，而且C模式的本地总线操作时序最简单，逻辑控制相对容易，其开发难度相对较低，因此，如无特殊需求，建议采用C模式。

2 总线仲裁

在PCI9054与本地总线的接口设计中，一般需采用一片可编程逻辑器件CPLD/FPGA进行逻辑控制。在其控制逻辑中，总线仲裁逻辑是最关键、最核心的部分，直接影响计算机运行的稳定性。如果总线仲裁逻辑设计不合理，当计算机对PCI扩展板上的硬件资源进行访问时，计算机将会死机，因此PCI9054本地总线的所有控制逻辑必须服从于总线仲裁逻辑。

下面以C模式为例对PCI9054的总线仲裁逻辑进行探讨。在C模式下，PCI9054的143脚LHOLD和144脚LHOLDA是总线仲裁输入输出信号控制引脚，从公开发表的论文来看，有人将这两个引脚直接与设计电路相连进行总线仲裁逻辑设计。笔者在设计时也曾采用过这种方式，结果计算机运行很不稳定，经常莫名其妙地死机。仔细分析这种方式设计的电路会发现，该设计电路其实是利用器件的引脚传输延时配合总线仲裁电路的时序关系的。一般情况下，当环境温度、工作电压等外界因素变化时，大多数据逻辑器件的引脚延时会有相应的变化，因此用器件引脚延时设计出的总线仲裁逻辑电路运行不稳定应该是预料之中的事。

利用D触发器只在触发时钟有效边沿对信号敏感的特性进行设计，提高电路运行的稳定性，是可编程逻辑器件设计中的一种常用技巧。图1是PCI9054在C模式下对外设进行单一周期写操作的时序图，图2是利用可编程逻辑器件中的D触发器设计出的总线仲裁电路。

ADS#、BLAST#和READY#信号的时序配合很重要，如果配合不好，计算机同样会死机。要提高电路稳定性，其设计思想与图2中的总线仲裁逻辑电路的设计思想相似。从多次实验情况来看，无论使用哪种工作模式，在该设计思想下设计出的本地总线控制逻辑电路运行非常稳定，没有死机的情况发生。 (责任编辑：admin)