浅论PCI9052芯片功能及其应用(2)

来源：211c　作者：网络　责任编辑：admin　发表时间:2018-11-05 12:03　

核心提示：1.3.2 复位 PCI9052总线接口在RST信号输入有效时将引起整个PCI9052的复位，并输出LRESET局部复位信号。PCI总线上的主机可以通过设置控制寄存器中的软件复位比特来对PCI9052进行复位，并输出LRESET信号。 1.3.3 访问

1.3.2 复位

PCI9052总线接口在RST信号输入有效时将引起整个PCI9052的复位，并输出LRESET局部复位信号。PCI总线上的主机可以通过设置控制寄存器中的软件复位比特来对PCI9052进行复位，并输出LRESET信号。

1.3.3 访问串行EEPROM接口

复位后，PCI9052开始读串行EEPROM，若读出的第一个字非FFFFH，则PCI9052继续读操作，否则认为EEPROM无效。对PCI9052来讲，EEP-ROM的前四个字节应为52H、90H、B5H和10H，其中9052H为设备号，10B5H为厂商编号。

1.3.4 访问内部寄存器

PCI9052提供了二种类型的片内寄存器，即PCI配置寄存器和局部配置寄存器，二者都只能由PCI总线和串行EEPROM访问，也可以通过设置寄存器CNTRL[3：12]禁止对后者的访问，这样就极大地增强了接口设计的灵活性。

1.3.5 直接数据传输模式

PCI9052支持PCI总线上的主处理器对局部总线上的设备进行读/写操作。PCI9052配置寄存器能够访问映射到局部的地址空间。同时片内的读写FIFO使PCI9052能够支持PCI总线与局部总线间的高性能猝发传送。PCI总线主控访问局部总线的示意图如图2所示。

1.3.6 PCI中断(INTA#)的产生

要产生P C I中断IN TA#，首先将寄存器INTCSR[6](PCI中断使能位)设置为“1”，如果需要以软件方式产生中断，则只需将INTCSR[7](软件中断位)设置为“1”。如果系统设计方案中选用由局部总线上的设备产生中断信号INTi1和INTi2，再生成PCI中断INTA#的方式，只要将寄存器INTCSR的相关位按表1进行设置，复位后INTCSR的值全部为“0”。

1.3.7 局部总线ISA接口模式

PCI9052的新功能是它直接提供给用户ISA逻辑接口，从而保证了ISA到PCI的平滑转换。另外，ISA接口还能支持8/16位存储器或I/O设备。用户通过对EEPROM的编程可将PCI9052置为ISA接口模式，在ISA接口模式下，LRESET信号将由低有效变为高有效，并可将局部总线空间2、3配置为无复用方式。

2、PCI9052设计实例

利用PCI总线目标接口芯片PCI9052设计PCI接口卡非常简便，图3是PCI主处理机读取SRAM的接口示意图，其主要功能是PCI主处理机通过PCI9052实现对RAM的单次或突发读、写操作。

2.1 电路连接

按照图3中的连接电路，对于SRAM主要有以下几个引脚：A(17，0)、I/O(7，0)、OE、CE、WE等。地址线A(17，2)与本地地址线LA[17，2]相连，根据PCI9052的LBE[0，3]#的定义，这里用8位数据总线将LBE0#与A0连接，LBE1#与A1连接，OE与PCI9052的CSO#相连。

PCI9052为设计人员提供了4个片选信号CS(3：0)#，可以为4个设备提供片选信号。这样可以避免设计人员在设计电路时设计片选解码电路，其地址和范围可由其对应的内部寄存内部本地寄存器配置。串行EEPROM用于存储配置寄存器内的配置信息，可以采用NM93C46或与之兼容的存储器。(责任编辑：admin)

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