基于ADV212芯片的视频压缩系统应用设计技术(3)

来源：维库　作者：网络　责任编辑：admin　发表时间:2018-11-01 11:30　

核心提示：A /D转换由ADV7402来完成，它能自动检测和转换标准模拟基带电视信号成符合CC IR656 的4:2: 2 分量数字视频数据。解压时的D /A 转换由ADV7321来完成。 FPGA 模块作为整个系统的中枢，对系统中各个芯片的信号起桥接

A /D转换由ADV7402来完成，它能自动检测和转换标准模拟基带电视信号成符合CC IR656 的4:2: 2 分量数字视频数据。解压时的D /A 转换由ADV7321来完成。

FPGA 模块作为整个系统的中枢，对系统中各个芯片的信号起桥接作用。首先根据需要完成图像数据的初步处理(如去噪) ，然后将数据分为大小相同的两个子块，使其能分别在两个ADV 212中处理。

同时，要向ADV212提供复位、片选、行场同步、读写以及时钟等信号控制多片ADV212的工作时序和工作模式，并为DSP提供复位信号。在工作过程中，FPGA 要不断向外部发送工作状态的反馈信息。在接到外部发来的!传输?指令后，码流将从存储器中被取出， FPGA 将其转换成比特流格式后发往信道。

DSP模块是系统的主控者，由它完成对ADV 212和ADV7402的初始化。ADV212 编码后产生的JPEG2000格式码流首先送入DSP进行加密，然后存入SDRAM 中等待接收! 传输?指令，在接到!传输?指令后DSP将存储在SDRAM中待发送的码流送入并/串转换DPRAM，最后在FPGA 中转换成串行比特流发送出去。

系统开始工作后，由外部的模拟视频信号传送给ADV 7402。ADV7402经过采样，量化后输出符合要求的数字视频数据。视频数据流通过FPGA 的桥接送给ADV 212进行压缩编码。为了提高压缩率，可以在视频数据流流过FPGA 时，对数据进行丢场处理，以人为降低需要进行压缩编码的源数据速率。

压缩好的数据再由ADV212传送给FPGA 里面的接口控制器，由控制器按照规定接口协议输出压缩数据流。

4、结束语

结合FPGA 和DSP 的高度灵活性，利用ADV 212的多片模式和高效的压缩性，设计出一个压缩/解压缩系统，较好的解决了高清视频信号高压缩、高保质难的问题，为高清数字电视业务的启动和普及打下了良好的基础。

(责任编辑：admin)

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